soc前端验证ｄｖ培训开班通知
西安市集成电路产业发展中心是西安市科学技术局直属事业单位，接受其它相关政府业务主管部门的行业指导和业务委托，旨在“组织、协调、引导、推进”西安集成电路产业的发展，并承担国家集成电路设计西安产业化基地的建设、管理与服务工作。
为促进西安本地微电子相关专业人才工程化培养工作，推动本地集成电路设计产业健康、快速发展，西安市集成电路产业发展中心将开展集成电路设计领域一系列培训课程。现将有关培训事项通知如下：
一、 培训内容
随着超大规模数字集成电路功能的日益完善和集成度的不断提高，各个领域对其功能设计完整性＼可靠性要求也变得越来越高。因此，对数字集成电路的故障检测＼诊断方法＼故障定位以及可测性设计技术是保障数字电路器件在使用中正常安全工作的重要手段。数字集成电路的验证测试是实现从设计到测试无缝连接的关键。在深亚微米制造工艺下，芯片验证测试的重要性尤为突出。其主要功能是验证设计和测试程序的正确性，确认芯片是否符合所有设计规范。主要包括以下几个方面：
集成电路芯片验证简介
day 1
1. 集成电路行业现状及发展趋势
2. 芯片验证概述
3. 设计/验证语言现状及其发展历史
4. 验证方法学现状及其发展历史
5. unix/linux基本操作
soc芯片架构以及验证初探
day 2
1. soc 芯片常用组成及架构
2. soc 芯片验证重点及难点
3. soc 芯片验证分层和重用理论
4. soc 芯片验证常用方法
5. soc 芯片性能和低功耗验证
先进的soc芯片验证流程
day 2～3
1. 基本ip level验证流程介绍
2. 验证需求提取方法及实践
3. 验证方案计划的制定
4. 验证用例的设计
5. 验证平台环境的搭建（平台架构设计）
6. 验证执行和评估
7. soc 项目验证流程探究
system verilog语言基础
day 4
1. system verilog语言简介
2. sv数据类型
3. 过程控制
4. 进程的概念和控制方法
5. 任务和函数
6. 接口
基于面向对象的随机化验证
day 4
1. oop概念
2. 类
3. 随机和约束
4. 基于类的随机化方法介绍
5. 随机种子
uvm验证方法学概述
day 5
1.uvm概述
2.uvm testbench基本架构介绍
3.uvm类库介绍
4.uvm report机制
uvm常用类
day 6
1. uvm object类型介绍
2. uvm component类型介绍
3. uvm phase概念
4. uvm objection机制
5. uvm tlm
uvm sequence机制
day 7
1. 什么是uvm sequence
2. 为什么要使用uvm sequence
3. 如何创建sequence
4. 怎样启动sequence
5. sequence的高级应用
6. uvm configure
覆盖率驱动的验证方法
day 8
1. 覆盖率简介
2. 代码覆盖率
3. 功能覆盖率
4. system verilog断言初步
验证执行及完备性评估
day 8
1. test case的运行基本脚本
2. case运行及debug
3. case review, 平台及test cases完善
4. run regression 以及结果分析
5. 覆盖率的分析
6. 验证报告
实践：
uvm验证环境开发实现
day 9.10
1. dut设计简介
2. interface实现
3. item实现
4. 创建agent
5. reference model实现
6. scoreboard实现
7. 验证环境中各组件的连接实现，创建env
8. 实例验证环境，创建验证case
9. 验证case中约束激励
二、培训对象
三、培训地点、时间及安排
西安软件园秦风阁b107室
培训时间为周天（开课时间2018.01月06日—2018.02月04日，培训期间每周二为为上机指导）。
课程安排及时间
合计: 10次合计60小时
授课 随课实验: 9:00-17:00(合计六小时) 10次合计60小时
赠送课程实验及现场辅导: 4次合计24小时
微信群互动及辅导:长期有效
四、收费标准
本次培训费用为3500元/人，西安市集成电路产业发展中心为促进相关专业人才工程化培养，由中心补贴后在校学生费用为2000元/人、企业在职员工为2500元/人。（名额有限 欲报从速）
五、讲师团队介绍
digital verification(dv)：2位10年以上工作经验的培训讲师，有丰富的前端验证和团队工作能力，丰富的企业培训相关经验。
联系人：曹洋 18091381063
邮 箱：caoyang@xaic.com.cn
来源：西安市集成电路产业发展中心
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